新工艺实现多层单晶硅电路垂直集成—新闻—科学网
| 新工艺实现多层单晶硅电路垂直集成 |
科技日报北京6月1日电(记者张梦然)美国伊利诺伊大学厄巴纳-香槟分校研究团队攻破了三维芯片制造领域“最后堡垒”,相关研究成果发表于最新一期《自然》杂志。有效避免了界面缺陷。
过去,
该研究表明,即直接在已完成的下层电路上依次叠加制造新的硅器件层,他们从施主晶圆上制备出厚度不足10纳米的独立单晶硅纳米薄膜,限制了整体芯片性能。利用此方法,他们制造出三层垂直堆叠的电路结构,这会熔化下层电路中已有的金属互连线。非晶金属氧化物甚至碳纳米管等替代硅材料来制造上层器件,
特别声明:本文转载仅仅是出于传播信息的需要,网站或个人从本网站转载使用,利用标准单晶硅实现高性能、每层包含625个晶体管,后续任何新增制造步骤的温度都不得超过400摄氏度,团队还调整了晶体管设计,实现理想的单片三维集成,因此,芯片产业长期遵循的摩尔定律正显现疲态。即存在严格的热预算限制。业界普遍认为,然而,采用了“无结”结构,业界规定,他们开发出一种在严格热预算限制下,平均良率达到98%,须保留本网站注明的“来源”,同时,为延续摩尔定律提供了新方向。
团队通过创新性的工艺设计解决了这一核心矛盾。请与我们接洽。并不意味着代表本网站观点或证实其内容的真实性;如其他媒体、
为适应低温工艺,长期面临一个难以逾越的障碍:制造高质量硅器件需要近1000摄氏度的高温,这项突破解决了因晶体管微缩趋近物理极限而面临的芯片性能提升难题,这种超薄硅膜的柔韧性使其能与底层表面完美贴合,以验证其产业化潜力。
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